Implementación de un multiplicador de punto flotante de doble precisión basado en el estándar IEEE 754-2008

José Itzcóatl Sandoval López, Juan José Raygoza Panduro, Susana Ortega Cisneros, Jorge Rivera Domínguez

Resumen


Este artículo presenta la síntesis, a partir de la descripción en VHDL de un multiplicador de punto flotante, basado en el estándar para Aritmética de Punto Flotante de IEEE (754™-2008) para microprocesadores, del cual se utiliza el formato binario para precisión doble de 64 bits. El estándar define formatos para representar diferentes tipos de datos los cuales son: normal, subnormal, cero positivo, cero negativo, infinito positivo, infinito negativo y un no número (NaN). Muchas aplicaciones basadas en procesadores embebidos requieren la capacidad para realizar operaciones aritméticas de punto flotante, lo cual es fundamental para una mejor precisión y desempeño del sistema en el procesamiento de los datos. Además de definir una solución de hardware, también, se implementa el diseño de un multiplicador de punto fijo, mediante el algoritmo de Booth.


Palabra(s) Clave(s): FPGAS, IEEE-754, multiplicación, punto flotante, VHDL.


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1986-2007 PDF

Referencias


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